编译后的 原理图 一直会与设计保持一致但是最终布线后会优化 PIN 的连接顺序，如上，把 I1 的走线优化到了 A5 的入口如果想要把 I1 布线后也在 A2 上，则需要加 LOCK_PINS 约束 （*LOCK_PINS “I1：A2”*）(* …

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